※ 本文轉寄自 ptt.cc 更新時間: 2022-02-05 23:50:06
看板 Tech_Job
作者 標題 [請益] 關於數位IC設計
時間 Sat Feb 5 14:55:34 2022
各位百萬年薪的學長姐們好
小弟今年要上研究所 主要是想做數位ic有關的
想在這之前先學一些東西
但礙於原本的學校似乎都沒開有關數位的課程
想問一下這兩門課的內容對於數位
在職場和研究所上有什麼幫助嗎
https://i.imgur.com/rLW1mYT.jpg
![[圖]](https://i4.disp.cc/imgur/rLW1mYTh.jpg)
![[圖]](https://i4.disp.cc/imgur/rIgCX8eh.jpg)
還想請問如果想要報名一些課程或是自學
應該從哪開始對於研究所和職場會比較好
謝謝各位
--
※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 123.240.63.145 (臺灣)
※ 文章代碼(AID): #1X_XzeGb (Tech_Job)
※ 文章網址: https://www.ptt.cc/bbs/Tech_Job/M.1644044136.A.425.html
推 : 不用那麼認真 去年進去發弟的雜魚有一半不會1F 02/05 14:56
→ : 看起來比較偏後端跟類比，跟數位關係不大，不過既2F 02/05 15:03
→ : 然是學生多學學還是好的
謝謝你 我目前也是這樣想的 總比什麼都沒學好→ : 然是學生多學學還是好的
推 : 類比薪水比較高辣 而且比較難 真的學會話語權很重4F 02/05 15:20
噓 : 哪間?5F 02/05 15:21
推 : ？？你真的知道數位ic在幹嘛嗎 第二張圖我看了啥6F 02/05 15:30
我內文的第四句：（我知道這是類比的課 所以才上來請教各位對未來讀研究所或是在職場上有沒有幫助
推 : 數位系統（邏輯設計）verilog 計算機組織 這三個先7F 02/05 15:32
→ : 學吧
→ : 學吧
推 : 想做數位，結果修類比的課0.0？9F 02/05 15:33
推 : 你這是類比的課程，當然不會有數位....你是不是考10F 02/05 15:35
→ : 錯組
→ : 錯組
學校(大學)只有開這兩個有關IC設計的實作課 今年暑假才去研究所
→ : 不重要 看實驗室跟畢業證書聊天而已，不要爛到一問12F 02/05 15:36
→ : 三不知就躺進
→ : 三不知就躺進
→ : 雖然類比薪水稍微高啦，但數位的工作缺是類比好幾14F 02/05 15:37
→ : 倍多，所以才會有人不夠，雜魚也收的情況
→ : 倍多，所以才會有人不夠，雜魚也收的情況
※ 編輯: Rjunkai (123.240.63.145 臺灣), 02/05/2022 15:59:40
推 : 想做類比沒實際Tape out根本沒人要16F 02/05 16:01
→ : 只休休課非常難做類比 有PCB做就很好了
→ : 修
→ : 只休休課非常難做類比 有PCB做就很好了
→ : 修
→ : 編輯文章回文好像會吃推文 不好意思19F 02/05 16:02
→ : 我還在上大學 暑假才會去研究所 本來的大學只有這
→ : 兩堂關於IC設計的實作課程 知道都是類比所以才上
→ : 來問 這些基礎課程對以後走數位在實驗室和職場有
→ : 沒有幫助 謝謝
→ : 我還在上大學 暑假才會去研究所 本來的大學只有這
→ : 兩堂關於IC設計的實作課程 知道都是類比所以才上
→ : 來問 這些基礎課程對以後走數位在實驗室和職場有
→ : 沒有幫助 謝謝
推 : 1還可以 2幾乎沒啥用24F 02/05 16:03
推 : 第一張圖可以學到MOSFET I-V線型操作區和數位電路25F 02/05 16:11
→ : 中長寬比、CMOS反向器邏輯01充放電以及靜態和動態
→ : 邏輯閘的設計。進階的話就會用這些元件從組合邏輯慢
→ : 慢兜出時序電路。
→ : 中長寬比、CMOS反向器邏輯01充放電以及靜態和動態
→ : 邏輯閘的設計。進階的話就會用這些元件從組合邏輯慢
→ : 慢兜出時序電路。
推 : 你有修過數位邏輯嗎 修過去修計算機組織 同時學veri29F 02/05 16:16
→ : log 比你貼的這兩張圖有用得多
→ : log 比你貼的這兩張圖有用得多
推 : 第一張圖學完後，接下來要搭配數位電路設計，像是如31F 02/05 16:16
→ : 何利用真值表實踐有限狀態機，然後直接利用邏輯閘
→ : 實踐這個有限狀態機。最後才是學習使用Verilog實踐R
→ : TL等複雜行為的電路。
→ : 何利用真值表實踐有限狀態機，然後直接利用邏輯閘
→ : 實踐這個有限狀態機。最後才是學習使用Verilog實踐R
→ : TL等複雜行為的電路。
推 : 第一張明明滿重要的 會提一些時序的東西35F 02/05 16:19
→ : 我也很想學Verilog 但學校沒有開 想請問有辦法透36F 02/05 16:20
→ : 過網路資源自學入門嗎
→ : 計算機組織跟邏輯設計都有修過
→ : 謝謝W M A 三位大大
→ : 過網路資源自學入門嗎
→ : 計算機組織跟邏輯設計都有修過
→ : 謝謝W M A 三位大大
推 : 第一張圖最完整的訓練就是用virtuoso從最基本的組合40F 02/05 16:21
→ : 邏輯閘兜出具有記憶和運算功能的小CPU，而且通過DRC
→ : 和LVS。
→ : 邏輯閘兜出具有記憶和運算功能的小CPU，而且通過DRC
→ : 和LVS。
推 : 去electronics版搜verilog 我記得有人問過verilog43F 02/05 16:22
→ : 自學
推 : hdlbits有簡單的題目可以練習 更狠一點github上有台
→ : 大cvsd跟交大iclab的題目跟code可以拿來想一想 比你
→ : 修vlsi system有用多了
→ : 自學
推 : hdlbits有簡單的題目可以練習 更狠一點github上有台
→ : 大cvsd跟交大iclab的題目跟code可以拿來想一想 比你
→ : 修vlsi system有用多了
→ : 好的 謝謝各位 祝大家都身體健康年薪翻倍48F 02/05 16:27
→ : 對數位IC沒啥幫助49F 02/05 16:52
推 : 學校在第一張圖之前應該會有數位系統導論或者入門50F 02/05 16:54
→ : 吧 開始教邏輯閘之類的...
→ : 吧 開始教邏輯閘之類的...
推 : 第一張圖不是沒用，只是對現階段原po來說幫助不大。52F 02/05 17:04
→ : 第一張圖應該是VLSI導論/系統設計之類的課程，我當
→ : 時修課時課程內容一半以上都是在看電路的電晶體層
→ : 次，如果原po是進到數位電路的實驗室，要看到電晶
→ : 體層次的機會應該低很多，尤其在verilog都不會的情
→ : 況下當務之急應該是先把verilog這塊惡補一下，之後
→ : 有閒暇再去修補這堂課也不遲
→ : 第一張圖應該是VLSI導論/系統設計之類的課程，我當
→ : 時修課時課程內容一半以上都是在看電路的電晶體層
→ : 次，如果原po是進到數位電路的實驗室，要看到電晶
→ : 體層次的機會應該低很多，尤其在verilog都不會的情
→ : 況下當務之急應該是先把verilog這塊惡補一下，之後
→ : 有閒暇再去修補這堂課也不遲
推 : 邏設、ic lab必學，verilog自學沒eda或fpga可以跑可59F 02/05 17:16
→ : 能沒啥感覺，看實驗室能不能給報上cic的課吧
推 : dic整個flow都能跑過一次比較好，重verilog到netlis
→ : t，甚至一些後段的flow也能摸一下比較有感覺
→ : 能沒啥感覺，看實驗室能不能給報上cic的課吧
推 : dic整個flow都能跑過一次比較好，重verilog到netlis
→ : t，甚至一些後段的flow也能摸一下比較有感覺
→ : 學生 要有多學習新的東西的能力。63F 02/05 17:27
推 : 這個UI 逢甲的?64F 02/05 17:31
推 : 邏輯設計，Verilog硬體描述語言，數位電路模擬與合65F 02/05 17:35
→ : 成，這幾樣應該有書可以看，先去了解一下
→ : 成，這幾樣應該有書可以看，先去了解一下
推 : 沒啥用67F 02/05 17:57
推 : 數位學程跟業界實戰差距很遠 但多上多學終究有收穫68F 02/05 18:01
推 : iCE40開發板買一塊，上網查github verilog教學。需69F 02/05 19:35
→ : 要的話我可以送你板子，但你要自己看自己學
→ : 要的話我可以送你板子，但你要自己看自己學
推 : Virtuoso這種東西知道就好不用熟，一線數位基本沒在71F 02/05 19:37
→ : 用吧
→ : 用吧
→ : 對了 你碩班讀啥 如果是四大 只學過三民主義都能去73F 02/05 19:49
→ : 聯發科當DD
→ : 聯發科當DD
推 : 不重要 發弟現在只要四大理工科都收75F 02/05 19:56
推 : 現在都不用看大學 門檻低到只要四大就能進去了嗎（76F 02/05 20:25
→ : ？
→ : 身邊還是有同學沒上的
→ : ？
→ : 身邊還是有同學沒上的
→ : 謝謝大家熱情的回覆0.079F 02/05 22:02
→ : 發哥子公司也很好上吧80F 02/05 23:03
推 : 雜魚現在真的多…81F 02/05 23:16
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